adc论文前沿信息_ai生成(2024年12月实时热点)
混合域ADC校准技术解析 今年的ISSCC会议上,一篇关于混合域ADC校准的论文引起了广泛关注。该论文介绍了一种40GS/s、7位的时域交织混合电压/时间域ADC,并详细阐述了其校准技术。 该ADC采用多相时钟生成技术,并引入了一个DCC修正模块。通过比较器对DCC输出时钟进行比较,实现了对时钟占空比的精确控制。这种校准方法以时间换精度,展现了平均思想在电路设计中的应用。 砥椸大亮点是VTC翻转电压的确定。传统反相器型VTC的阈值电压难以准确调整,易受PVT影响。而该论文提出了一种反馈控制方法,将VTC的阈值电压精确控制在Vth,rep,为电路设计带来了新的思路。 ᠦ来说,这篇论文展示了混合域ADC校准技术的最新进展,为高精度ADC的设计提供了有益的参考。
2024年10月27日,上海交通大学谢青、项晓刚、法国巴黎西岱大学Richard Moreau共同通讯在Journal of Hepatology(IF=26.8)杂志在线发表了题为“Blood markers for type-1,-2, and -3 inflammation are associated with severity of acutely decompensated cirrhosis”的研究论文,该研究表明1型、2型和3型炎症的血液标志物与急性失代偿期肝硬化的严重程度相关。研究结果表明,在ADC患者中,与1型、2型和3型炎症相关的细胞因子血液水平的变化,以及中性粒细胞增多、淋巴细胞减少和抗炎信号升高分别与进展为ACLF的风险增加相关,与临床上明显的诱因的存在无关。「iNature」
FoM:理解并优化性能与功耗的平衡 在电子工程的世界中,Figure-of-Merit(FoM)是一个广泛使用的概念,它为评估系统性能提供了一个统一的度量标准。Gao et al. 在他们的论文“Jitter Analysis and a Benchmarking Figure-of-Merit for Phase-Locked Loops”中,深入分析了PLL(相位锁定环)的抖动特性,并提出了一个实用的FoM表达式。 首先,他们研究了VCO(压控振荡器)到PLL的噪声传递函数(NTF),这是PLL输出噪声的重要组成部分。接着,他们分析了PLL中其他组件,如PD(鉴相器)、CP(电荷泵)、LPF(低通滤波器)、DIV(分频器)和REF(参考信号),对输出噪声的影响。在这些组件中,LPF和REF的噪声由于量级较小,可以忽略不计。 论文进一步推导了与抖动相关的设计参数,以及CP带来的相位噪声与设计参数之间的关系。他们还研究了PLL的输出抖动与相位噪声之间的关系,指出PLL的抖动是VCO的抖动与环路抖动的总和。 砥褼化PLL的抖动时,需要在VCO和环路之间进行权衡。通过调整它们的NTF,即调整带宽,可以找到最佳平衡点。最终,他们得出结论,最佳化发生在VCO和环路的贡献相等时,同时它们的功耗也应相等。 论文还给出了PLL的FoM表达式,这是一个在Jitter和功耗之间进行折衷的指标。理想情况下,当功耗增加一倍时,Jitter会变为原来的1/sqrt(2)。这个FoM表达式一直沿用至今,为各种系统设计提供了一个有力的工具。 除了PLL,FoM在其他系统中也有广泛的应用。例如,在ADC(模数转换器)中,FOM=功率/(采样速率*2^ENOB),而在功率器件中也有相应的FoM。无论是在电路、系统还是设备中,FoM都是一个重要的性能指标。 ᠧ解FoM的关键在于认识到它背后的经济学原理:投入(Power)与产出(电路性能指标)之间的平衡。通过不断优化设计方法、架构和创新技术,我们可以提高FoM,从而提高投入产出比和效率。 来说,FoM是一个强大的工具,它帮助我们理解和优化电子系统的性能和功耗。通过深入研究FoM的概念,我们可以更好地掌握如何在不同系统之间进行权衡和优化。
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